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设计同步时序逻辑电路时，若有两个状态等价，可以只保留这两个状态中的一个。

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设计同步时序逻辑电路时，若有两个状态等价，可以只保留这两个状态中的一个。

A.正确

B.错误

参考答案:

答案：A

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